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去年在設(shè)計(jì)一款無(wú)線(xiàn)產(chǎn)品的時(shí)候，為了節(jié)省時(shí)間，使用了別人設(shè)計(jì)好的PCB源文件，結(jié)果遇到了一件有意思的事情——Allegro中過(guò)孔重疊卻不報(bào)DRC錯(cuò)誤，見(jiàn)下圖。由于這個(gè)PCB源文件最初不是我設(shè)計(jì)的，所以原來(lái)的工程師做的特殊設(shè)定我并不清楚，但這個(gè)過(guò)孔重疊的問(wèn)題肯定要解決才行。

第一步，確定Allegro Constrains Manager - ->Physical - ->Physical Constrain Set- ->All Layers- ->Pad-Pad Connect已經(jīng)設(shè)定為NOT_ALLOWED。

第二步，確定Allegro Constrains Manager - ->Same Net Spacing- ->Same Net Spacing Constrain Set- ->All Layers- ->Vias- ->Thru Via To Thru Via已經(jīng)設(shè)定了同網(wǎng)絡(luò)過(guò)孔間距，這里是5mil。

第三步，確定Setup- ->Constrains- ->Modes- ->Same Net Spacing Modes- ->Vias已經(jīng)勾選。

以上三步都是特別容易想到的，然而，這并不能解決過(guò)孔重疊卻不報(bào)錯(cuò)的問(wèn)題。后來(lái)，我在Allegro Constrains Manager里面找了好久才最終確定，一定要將Allegro Constrains Manager - ->Same Net Spacing- ->Same Net Spacing Constrain Set- ->All Layers- ->Options- ->Enable DRC By-Layer由FALSE改為T(mén)RUE，才會(huì)正常報(bào)出DRC錯(cuò)誤。